Simulador de memoria cache

Autores
Aiello, Andrés; Rinaldi, Nicolás; Silveira, Rodrigo Ignacio
Año de publicación
2002
Idioma
español castellano
Tipo de recurso
documento de conferencia
Estado
versión publicada
Descripción
El proyecto consiste en el desarrollo de un programa simulador de arquitecturas de memoria cache que permite observar las tasas de aciertos y fallos en la memoria cache y los cambios en los tiempos de ejecución de programas en una computadora según la presencia o no de distintas configuraciones de tipo de memoria. Con este proyecto quisimos corroborar algunos de los resultados vistos en la materia Organización del Computador. El programa no solamente resultó ser útil para el propósito enunciado anteriormente sino que también constituye una herramienta didáctica muy efectiva para la enseñanza de la materia.
Sociedad Argentina de Informática e Investigación Operativa
Materia
Ciencias Informáticas
Simulación
Memoria cache
Educación
Arquitectura
Sistemas
Nivel de accesibilidad
acceso abierto
Condiciones de uso
http://creativecommons.org/licenses/by-nc-sa/4.0/
Repositorio
SEDICI (UNLP)
Institución
Universidad Nacional de La Plata
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